系统同步下输入输出和时钟规划

其他 2021-04-03 20:32:05 阅读次数: 0

文章目录

1.IO约束简介
2.一个时序约束实例
3.IO约束命令格式
输出约束

1.IO约束简介

在这里插入图片描述

时钟和数据都由上一级芯片给出，我们对本级FPGA约束，这种情况称为系统同步。源同步是数据和时钟都由本级芯片提供给下一级，我们对本级FPGA约束，约束稍微复杂。本文只涉及了系统同步。
UCF不用管，现在的vivado使用XDC

2.一个时序约束实例

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