默认是无符号的
如果要用有符号的要用integer 或者用 reg signed
默认的是无符号数
有符号是可以加上 reg signed [3:0] a....
是无符号数，它表示寄存器类型变量，是二进制编码，而不是一个多大的数字。
Verilog HDL中reg默认是有符号数还是无符号数
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转载自blog.csdn.net/weixin_37182342/article/details/90057067
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